什麽是DevOps?(三)不刻意追求資源百分百使用率
什麽是DevOps?(三)不刻意追求資源百分百使用率

大部分的工廠或公司,通常都會認爲,所有的資源,不管是人或機器,因爲都固定要付出成本,那當然要追求100%的使用率(稼動率),單位產出應該就會更高,這種概念基本上沒有錯,但要成立的前提,是所有流程節點的產出速度是相同的,也就是沒有所謂的「瓶頸點」。

但現實上,不可能所有節點的速度都一樣,一定會有所謂的瓶頸點,而對瓶頸點來説,使用率要越高越好沒錯,但其他非瓶頸點的資源使用率如果過高,反而會造成最終產出時間降低,怎麽說呢?來看下面這張圖。

橫軸是資源的使用率,縱軸是工作等待長度,它的公式是資源使用率/資源空閒率,這是什麽意思呢?先假設每個工作的優先程度是一樣重要的,當某個資源,它的使用率是50%,也就是空閒率是50%(100%至50%),當有一個新工作進到流程裡時,因爲它有50%的時間在忙其他工作,要等它把手頭上的工作完成了,才有空接新的工作,所以工作等待長度為50%/50%=1,把它當作一個等待的長度單位(1分鐘、1小時或1天),那當資源的使用率達到90%時,工作等待長度將變成90%/10%=9,表示當一個資源使用率達到90%,若有新的工作進來時,要先把前面90%的工作完成,才能做新的,因此等待的時間會是使用率50%的9倍,使用率越接近100%,等待的時間是越趨近於無窮大。而如果一個工作流程要經過5個節點(人員或站台),若每個節點資源的使用率都是90%的話,那等待的時間會是使用率50%的9×9×9×9×=45倍,流程經過的節點愈多,等待的時間越長。

這樣會產生什麽樣的結果?如果在工廠裡,就會看到越來越多的半成品(WIP, works in process)堆在瓶頸點前等待處理,而如果是在軟體開發,同樣會看到越來越多待辦工作WIP卡在瓶頸點,最終完成的速度,還是被瓶頸點的處理速度綁死。

所以這也是爲什麽 限制理論TOC 一直強調,先讓瓶頸點的利用率達到最高,然後其他非瓶頸點的資源都要來配合瓶頸點,不要刻意追求百分百使用率,就算放在那邊讓它有閒置時間也沒關係,否則積了一堆半成品或待辦事項,以有效生産throughput的角度來看,這些未完成的代辦工作WIP,是不能算進收入的,通通都是浪費資源而已,有些會計準則會把這些未完成品算作資產,這就看各個公司怎麽去判定了。

因此,最後還是要重複一下限制理論的核心概念:

  1. 找出系統的瓶頸(限制因素,整體效能的上限)
  2. 決定如何利用瓶頸(充分利用瓶頸資源)
  3. 根據上面的決定,讓其他流程來配合瓶頸(一切以瓶頸為出發)
  4. 提高瓶頸的能力(整體效能提高)
  5. 回到步驟一,重新檢視新的瓶頸

所以任何管理,要提升效率,都是要不斷的提升瓶頸點的能力,但要注意,

瓶頸點是會移動的。

當提升了瓶頸點A的能力,在整個流程裏面,它可能就不是瓶頸點了,出現了新的瓶頸點B,以此類推,最後使每個節點的產出速度都差不多時,這時候會發現,所有的節點自然而然地,使用率都會將近100%了。

責任編輯:陳建鈞

本文由李正霖授權轉載自其blog

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兼顧創新與客戶需求,蔡司半導體以微影跟數位雙引擎助半導體客戶成長卓越
兼顧創新與客戶需求,蔡司半導體以微影跟數位雙引擎助半導體客戶成長卓越

在全球半導體產業鏈中,蔡司半導體製造科技(ZEISS Semiconductor Manufacturing Technology, ZEISS SMT)一向低調但卻扮演不可或缺的角色,例如,花費30餘年時間投入研發,與全球最大的晶片微影設備供應商艾司摩爾(ASML)合作推進極紫外光微影(EUV)技術,協助台積電等客戶將電路微縮至奈米甚至埃米級的精細尺度,打造更小、更快、更省電的晶片,靈活應對瞬息萬變的市場需求。

從EUV微影光學系統開始,ZEISS以光罩檢測與驗證、先進封裝與失效分析完善服務

「目前最令人振奮的進展是高數值孔徑EUV(High-NA-EUV)技術。」蔡司半導體技術長暨產品策略負責人Thomas Stammler博士表示,這項技術將幫助晶圓製造商邁向2奈米甚至埃米級製程,更好滿足人工智慧(AI)晶片等高效能應用需求。

蔡司半導體提供的服務不僅止於微影光學領域,隨著製程複雜度提升,蔡司因應客戶需求將產品服務範疇逐步擴展到光罩檢測、製程控制,以及先進封裝與失效分析等跨領域解決方案,協助半導體客戶創新與持續產業變革。

ZEISS SMT
蔡司半導體技術長暨產品策略負責人Thomas Stammler博士分享蔡司半導體的最新產品技術進程。
圖/ ZEISS SMT

例如,蔡司半導體推出光罩檢測與驗證系統–AIMS® EUV–協助晶圓製造廠模擬EUV設備的真實運作條件,判斷光罩上有那些關鍵缺陷,缺陷修復後還可以協助驗證是否有修復成功,確保光罩品質,進而保障良率與降低生產成本。

隨著先進製程逼近物理極限,產業轉向先進封裝尋找新突破:無論是以3DIC進行堆疊、還是以Chiplet進行模組化設計,都讓晶片可以在效能與能耗之間找到新平衡。蔡司看準這波趨勢,不僅提供異質整合相關設備,更將其在醫療影像、顯微鏡等領域累積的技術力,延伸到半導體檢測,讓解決方案更具差異化,也能快速回應市場變化。

化180年經驗為創新基礎,以數位化驅動持續創新

蔡司半導體為什麼能成為艾司摩爾EUV與High-NA-EUV微影設備的光學系統獨家供應商?答案來自近180年的技術底蘊與持續創新的企業文化。

「近180年的累積,讓我們能挑戰極端工藝,例如打造原子級平整度的EUV鏡面。」Thomas Stammler進一步解釋,蔡司半導體不僅傳承傳統光學工藝,也擅於跨域創新,將演算法應用於光學設計、利用AI提升檢測精度,並透過數據串聯製程控制。

事實上,蔡司半導體早在許多年前就將數位化與人工智慧技術融入研發設計、生產製造與產品服務等環節,持續優化核心競爭力。舉例來說,為了讓EUV設備鏡面達到原子等級的平整度,蔡司半導體在設計階段便透過數據分析與人工智慧技術進行模擬、修正與驗證,確保鏡面平整度符合預期;此外,也將人工智慧與數位化科技應用在光罩檢測、修復、量測,確保產品功能有利於客戶發現與修復缺陷、進而提升良率等。

以客戶需求為核心,鏈結供應鏈資源與力量成就共好

「我們的數位化應用不僅是單純的優化產品,而是支持客戶共同研發,解決真正的營運痛點。」Thomas Stammler進一步指出,台灣半導體客戶具備技術領先地位,需要在地團隊與客戶進行定期且密切的互動溝通以確保創新模式與客戶需求一致。「我們有很多前瞻技術測試與驗證都是從台灣開始,這也是我們會持續加碼台灣投資的原因之一。」

台灣蔡司半導體總經理范雅亮面帶微笑地解釋:「台灣在全球半導體產業具關鍵地位,台灣團隊的角色不僅僅是銷售與售服,更參與研發與應用工程,鏈結全球資源,快速回應客戶問題,同時,確保技術解決方案與客戶需求一致。」

ZEISS SMT
台灣蔡司半導體總經理范雅亮表示,蔡司半導體的全球在地組織架構讓團隊成員可以快速回應客戶與市場需求。
圖/ ZEISS SMT

這份承諾,不僅是技術合作,亦體現在人才培育。為了讓在地團隊與德國總部保持同步,蔡司半導體建立跨國人才交流機制:不只是派台灣工程師到德國進行長期訓練,也讓德國專家定期來台灣與團隊共事,形成雙向交流的人才循環。「透過雙向交流模式,台灣工程師能第一時間掌握最新技術脈動,同時把在地客戶需求回饋給德國研發團隊,加速解決方案的落地。」范雅亮如是說道。

為了向台灣半導體產業生態圈傳遞:蔡司半導體全面布局「前段製程到後段封裝」並提供相應產品服務,於SEMICON Taiwan 2025國際半導體展期間,以論壇跟專家座談等多元形式與台灣生態圈互動,以全球資源、在地合作的方式,與台灣半導體產業生態圈一同前行。

展望未來,蔡司半導體不僅會持續投入技術創新,也會從各個面向深化與台灣的連結,協助客戶持續突破極限,邁向卓越成長。

更多資訊歡迎官網了解:蔡司半導體

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